高速數位設計

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加速設計成功

隨著技術進步和裝置尺寸縮小,印刷電路板 (PCB) 變得更加複雜且密度更高。更快的洞察力對於設計成功至關重要。了解最新標準,並探索 Keysight 電子設計自動化 (EDA) 解決方案如何加速您的高速數位 (HSD) 設計應用工作流程。

了解 HSD 電路設計的基礎知識。

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跟上現代電子產品的複雜性

探索從概念到模擬、模擬和合規性,採用整體設計方法以實現高速數位設計成功的四個考量因素。

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您的 PCIe® 6.0 之路

了解 PCIe® 6.0 所導入的新功能,以及從模擬到協定測試的端對端解決方案所帶來的關鍵優勢。

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DDR5 之路

檢閱標準機構 JEDEC 為實現 DDR5 所採取的技術路線,以及超越 DDR5 所需的其他考量。

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USB4 技術概覽

探索 USB4 技術、架構與多層級信號傳輸。

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什麼是小晶片(Chiplet),為何您應該關注?

探索小晶片如何實現模組化元件的開放生態系統,可重複使用和客製化。

精選課程

探索標準設計課程

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DDR 記憶體匯流排分析

了解記憶體通道前置和後置佈局模型的重要性,以及如何建構和設計這些模型。

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記憶體設計人員教學課程

了解如何使用端對端工作流程執行眼圖量測。

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High-Speed Digital Interfaces Optimization
學習模擬高速數位介面的新技能,並探索設計選擇以改善訊號完整性。

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DDR5 記憶體設計快速入門

快速入門 DDR5 的新挑戰,以及如何為 DDR5 建立新的設計到測試工作流程的策略。

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DDR 基於模擬的符合性測試

逐步了解多種記憶體標準(包括 (LP) DDR 和 DDR5)的符合性測試與設計探索。

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DDR5 設計工作流程最佳化

獲取透過整合式設計自動化和分析軟體減少 DDR5 損耗反射的知識。

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DRAM AMI 建模

了解如何建立和使用 JEDEC IBIS AMI 模型,用於動態隨機存取記憶體 (DRAM) 驅動器和接收器。

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用於 USB4 模擬與量測的進階技術

檢閱 USB4 技術、訊號衰減、通道效能、TP3 相符性點以及多位準訊號傳輸。

探索訊號完整性課程

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訊號完整性最佳化

探索三種最佳化設計中訊號完整性的方法,以及如何修正異常的差動阻抗、SDD11 和 SDD21。

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設計穩健的訊號完整性工作流程

深入探討影響訊號完整性的機制,並學習設計疑難排解的實用技巧。

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找出並解決訊號完整性問題

了解如何識別訊號完整性問題,並取得有助於您開啟數位通道眼圖的技術。

探索電源完整性課程

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傳導 EMI 模擬

了解傳導電磁干擾 (CEMI)、相關標準,以及如何設定和執行模擬。

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電容器選擇、佈局與最佳化

使用 EM 模擬器選擇正確的電容器並最佳化其佈局,以實現低雜訊的電源分配。

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電源完整性模擬工作流程

了解如何使用端對端工作流程,該工作流程非常適合解決下一代低電壓、高電流電源傳輸設計。

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配電網路設計

探索全面的電源完整性工作流程,以設計出平坦阻抗,並找出電源軌上振鈴的根本原因。

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電源完整性模擬與量測技能

應用數位分身模擬設計,並使用進階示波器量測電源完整性訊號。 

深入探索高速數位設計的更多見解和精心編譯的資源

 
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