PCIe® 6.0レシーバー テスト方法

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ビットエラーレートテスターとテスト自動化ソフトウェアを用いたPCIe 6.0レシーバーのコンプライアンス試験

PCIe®レシーバーのコンプライアンスおよび相互運用性試験には、ストレスPAM4信号を生成可能なパターンジェネレーターを備えたビットエラーレートテスター（BERT）と、信号およびイコライザーを校正するための高帯域幅（50 GHz超）オシロスコープが必要です。テストシステムは、最大64 GT/sを実現するために、PCIe 6.0の32 GBaud PAM4シグナリング速度に準拠して動作する必要があります。

マルチレベルシグナリングは、ノイズマージンが小さいため、PCIe 6.0レシーバーの信頼性の高いテストに新たな課題をもたらします。テスト自動化ソフトウェアは、PCIe 6.0レシーバーのコンプライアンス試験を簡素化します。この試験では、さまざまな条件下でのビットエラーレートなどのパラメータを測定するために、正確に校正された劣化信号を被試験デバイスのレシーバーに繰り返し印加します。

PCIe 6.0 レシーバー適合性テストソリューション

PCIe 6.0レシーバーのコンプライアンス試験には、正確な校正と再現性のあるエラー測定が必要です。キーサイトのPCIe 6.0レシーバーコンプライアンス試験ソリューションには、ストレスPAM4信号を生成するパターンジェネレーターと、ビットエラーレートおよびその他のデバイスの性能測定を行うエラー検出器を備えた64 GBaud BERTが含まれています。このソリューションには、ストレス信号およびイコライザー校正用の59 GHz UXRシリーズオシロスコープも含まれています。テスト自動化および信号解析ソフトウェアは、開発者がデバイスのレシーバー許容度試験を信頼性高く、再現性よく実行し、PCI-SIGの仕様へのレシーバーコンプライアンスを保証するのに役立ちます。
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