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テープアウト前にサイドチャネル漏洩を検出し、その発生箇所を特定し、対策を講じます。 Inspector SC2 プレシリコン・サイドチャネル解析により、ハードウェアセキュリティ、設計、および検証チームは、シリコンが製造される前の設計段階および開発中に、サイドチャネルの脆弱性を特定することができます(プレシリコン)。 従来のポストシリコンテストでは、製造されたデバイスに漏洩が存在するかどうかを判断することしかできませんが、Inspector SC2 プレシリコン・サイドチャネル解析は、設計内のどこから漏洩が発生しているかを可視化し、チームが開発ライフサイクルの早い段階で根本原因を特定し、緩和策を評価できるよう支援します。 Inspector SC2 プレシリコン・サイドチャネル解析は、テストベクトルと設計アクティビティデータを用いて、レジスタ転送レベル(RTL)、合成済みネットリスト、およびゲートレベルの設計を分析することで、どの信号が漏洩しているか、漏洩量はどれくらいか、いつ漏洩が発生するか、そして設計内のどこから発生しているかを特定します。この可視性により、チームは対策の検証や設計案の比較が可能となり、製造後に脆弱性が発見されることによるコストとリスクを低減できます。
Key Features
Pre-silicon security evaluation; Integration with existing EDA workflows; Early vulnerability detection; Design-to-security feedback; Proven inspector methodologies; Reduced redesign risk; Secure-by-design development
Applications
Pre-silicon side-channel analysis, Leakage assessment, Semiconductor security evaluation, Secure chip design, Security validation, Certification preparation
License types
Perpetual, Subscription
Functionality
EDA integration, Simulation analysis, Leakage assessment, Root cause analysis, RTL analysis, Netlist analysis, Place-and-route analysis, Security verification
License options
Floating license, USB-based portable license
同梱品をご確認いただき、キーサイトが提供する利用可能なアップグレードオプションをご覧ください。
Inspector SC2 Pre-Silicon Side-Channel Analysisは、半導体チームがテープアウト前にサイドチャネルリークを検出および特定するのに役立ちます。これにより、設計変更がより迅速、低コスト、かつ容易に実装できるようになります。
Inspectorは、テストベクトル、VCDアクティビティファイル、および既存の電子設計自動化 (EDA) ワークフローを通じて生成されたオプションのパワーモデルを使用して、RTL、合成済みネットリスト、およびゲートレベルの設計を解析し、リークを特定し、その深刻度を測定し、原因となる信号とモジュールを特定します。実用的な根本原因分析を提供することで、チームは対策を検証し、実装オプションを比較し、RTL、合成済みネットリスト、およびゲートレベルの設計全体でリークを比較して、設計フロー中に導入された変更を特定できます。
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社内での講師主導トレーニングやeラーニングにより、迅速に測定を実施できます。
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