PCI Express® und Compute Express Link
- Design & Simulation
- Senderprüfung
- Empfängertest
- Verbindungstest
- Protokolltest
Verkürzen Sie die Markteinführungszeit und minimieren Sie gleichzeitig das Risiko von Neuentwicklungen. Bewältigen Sie die steigende Designkomplexität und kontrollieren Sie hohe Prototyping-Kosten mit effizienten Hochleistungs-Simulationstools.
Power- und Signalintegritätsanalyse
Richten Sie komplexe Signale mit der Geschwindigkeit, Bandbreite, Präzision und Flexibilität ein, um den Herausforderungen von KI-Rechenzentrums-Implementierungen der nächsten Generation gerecht zu werden.
AMI-Modellerstellung
Beschleunigen Sie die Generierung von algorithmischen PCIe-Modellierungsschnittstellen für Sender und Empfänger.
Beschleunigen Sie die Markteinführung mit automatisierten Konformitätstests für Sender und einer detaillierten Designvalidierung, die sicherstellt, dass Ihre Hardware den PCI-SIG-Standards vollständig entspricht.
Fehlerbehebung und Automatisierung von Transmitter-Konformitätstests bis zu PCIe® 7.
Beschleunigen Sie die Erkennung von Impedanzdiskontinuitäten.
Debuggen und charakterisieren Sie die Bandbreite und das Peaking der Phasenregelschleife (PLL) Ihres PCIe® 5.0- und 6.0-Designs.
Debuggen und automatisieren Sie den PCIe® 5.0 Sender-Konformitätstest.
Debuggen und automatisieren Sie den PCIe® 5.0 Sender-Konformitätstest.
Beschleunigen Sie die Markteinführung mit automatisierten Empfänger-Konformitätstests und einer umfassenden Designvalidierung, um sicherzustellen, dass Ihre Hardware den PCI-SIG-Standards vollständig entspricht.
Automatisierte Kalibrierung von Stresssignalen und Konformitätstests von PCIe® 7.0 ASICs.
Automatisieren Sie die Stresssignal-Kalibrierung und den Konformitätstest von PCIe® 6.0 ASICs.
Fehlerbehebung und Automatisierung von Compliance-Tests für PCIe® 6.0 CEM-Erweiterungskarten und -Systeme.
PCIe® 5.0 Basis-Empfängertest
Automatisieren Sie die Stresssignal-Kalibrierung und den Konformitätstest von PCIe® 5.0 ASICs.
Debuggen und automatisieren Sie den Konformitätstest von PCIe® 5.0 CEM-Zusatzkarten und -Systemen.
Debuggen und automatisieren Sie den Konformitätstest von PCIe® 5.0 M.2-Geräten und -Hosts.
PCIe® 4.0 Basis-Empfängertest
Automatisieren Sie die Stresssignal-Kalibrierung und den Konformitätstest von PCIe® 4.0 ASICs.
Debuggen und automatisieren Sie den Konformitätstest von PCIe® 4.0 CEM-Zusatzkarten und -Systemen.
Signalintegritätsmessung
Vektornetzwerkanalyse mit bis zu 4 Ports
Führen Sie schnelle Echtzeitanalysen bis zu 53 GHz durch.
Erweiterte Zeitbereichsanalyse mit TDR
Führen Sie eine vollständige Bauteilcharakterisierung passiver Komponenten durch.
Multiport-Vektornetzwerkanalyse
Beschleunigen Sie die Validierung und das Debugging von PCIe- und CXL-Designs mit tiefgreifenden Protokolleinblicken, schnellerer Ursachenanalyse und Vertrauen in jeder Entwicklungsphase.
PCIe®- und CXL-Protokollanalysatoren
Debuggen Sie Ihre Designs schneller mit tiefgreifenden Protokolleinblicken und beispielloser Signalintegrität.
Automatisieren Sie die PCIe®- & CXL-Verkehrsanalyse und Konformitätstests.
PCIe®- und CXL-Protokoll-Exerciser
Generieren Sie realistischen Datenverkehr bis zu 64 GT/s und emulieren Sie ein Host-System.
Automatisieren Sie die PCIe®- & CXL-Verkehrsanalyse und Konformitätstests.
PCIe®- und CXL-Protokoll-Test-Backplanes
Testen Sie mit einer stabilen, kabellosen Backplane für eine beispiellose Signalintegrität.
PCIe® und CXL Anwendungsfälle
Erfahren Sie mehr über PCIe® und CXL Lösungen
FAQs zu PCIe®- und CXL-Lösungen
PCIe 6.0 führte die PAM4-Signalisierung und FLIT-basierte (Flow Control Unit) Kodierung ein, was neue Herausforderungen für die Senderanalyse, Empfängerkalibrierung, Entzerrung und das Protokoll-Debugging mit sich bringt.
PCIe 7.0 verdoppelt den Durchsatz erneut auf 128 GT/s und unterstützt damit KI-Beschleuniger der nächsten Generation, Rechenzentrumsinfrastrukturen und Hochleistungsrechnersysteme. Die Validierung trägt dazu bei, die Interoperabilität und Systemzuverlässigkeit bei diesen extremen Geschwindigkeiten zu gewährleisten.
Durch den Einsatz eines vollständigen Test-Workflows, der Simulation, Charakterisierung, Protokollanalyse, Konformitätstests und Empfängervalidierung aus einer einzigen Anbieterumgebung umfasst.
CXL ist eine offene Interconnect-Technologie, die auf der physikalischen PCIe-Schicht aufbaut und eine kohärente Kommunikation zwischen CPUs, Beschleunigern, Speichergeräten, GPUs und anderen Systemkomponenten ermöglicht.
CXL verwendet denselben physischen Stecker und dieselbe elektrische Schnittstelle wie PCIe. Während der Link-Initialisierung können Geräte aushandeln, ob sie im PCIe-Modus oder im CXL-Modus betrieben werden sollen.
Obwohl CXL die physikalische Schicht von PCIe nutzt, führt es neue Protokolle, Kohärenzmechanismen, Speichermodelle und Fabric-Architekturen ein, die spezielle Validierungs- und Debugging-Funktionen erfordern.
Zu den wichtigsten Herausforderungen zählen:
- Validierung der Speicherkohärenz
- Testen des Fabric-Managements
- Verifizierung des Memory Pooling
- Interoperabilität zwischen Anbietern
- Protokollkonformität über komplexe Systemarchitekturen hinweg
Memory Pooling ermöglicht es mehreren Hosts oder Beschleunigern, Speicherressourcen dynamisch zu teilen, wodurch die Auslastung und Skalierbarkeit in KI- und Cloud-Rechenzentrumsumgebungen verbessert wird.
CXL ermöglicht Speichererweiterung, Speicheraustausch und disaggregierte Architekturen, die dazu beitragen, den wachsenden Anforderungen an Speicher und Bandbreite für KI-Trainings- und Inferenz-Workloads gerecht zu werden.
Achten Sie auf:
- Unterstützung für aktuelle CXL-Spezifikationen
- Analyzer- und Exerciser-Funktionalität
- Datenverkehrsgenerierung und Fehlerinjektion
- Kohärenzvalidierung
- Integration der Speicherprotokollanalyse in PCIe-Protokoll-Debug-Workflows
Ja. Keysight bietet integrierte Protokollanalysatoren, Exerciser, Software und Testlösungen für die physikalische Schicht, die Ingenieure bei der Validierung von PCIe- und CXL-Designs über den gesamten Entwicklungszyklus hinweg unterstützen.
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