PCI Express® und Compute Express Link
- Konstruktion & Simulation
- Senderprüfung
- Empfängertest
- Verbindungstest
- Protokolltest
Verkürzen Sie die Markteinführungszeit und minimieren Sie gleichzeitig das Risiko von Designänderungen. Bewältigen Sie steigende Designkomplexität und kontrollieren Sie hohe Prototyping-Kosten mit effizienten, leistungsstarken Simulationswerkzeugen.
Leistungs- und Signalintegritätsanalyse
Komplexe Signale mit der Geschwindigkeit, Bandbreite, Präzision und Flexibilität einrichten, die für die Herausforderungen von KI-Rechenzentrumsimplementierungen der nächsten Generation erforderlich sind.
AMI-Modellerstellung
Beschleunigung der Generierung von PCIe-Algorithmenmodellierungsschnittstellen für Sender und Empfänger.
Beschleunigen Sie die Markteinführung durch automatisierte Konformitätsprüfungen der Sender und eine eingehende Designvalidierung, um sicherzustellen, dass Ihre Hardware vollständig den PCI-SIG-Standards entspricht.
Fehlerbehebung und Automatisierung von Transmitter-Konformitätstests bis zu PCIe® 7 .
Die Erkennung von Impedanzdiskontinuitäten beschleunigen.
Debuggen und charakterisieren Sie die Bandbreite und die Spitzenwerte der Phasenregelschleife Ihres PCIe® 5.0- und 6.0-Designs.
Fehlerbehebung und Automatisierung des PCIe® 5.0 Transmitter-Konformitätstests.
Fehlerbehebung und Automatisierung des PCIe® 5.0 Transmitter-Konformitätstests.
Beschleunigen Sie die Markteinführung durch automatisierte Empfänger-Konformitätsprüfungen und eine eingehende Designvalidierung und stellen Sie so sicher, dass Ihre Hardware vollständig den PCI-SIG-Standards entspricht.
Automatisierte Kalibrierung von Stresssignalen und Konformitätstests von PCIe® 7.0 ASICs.
Automatisierte Kalibrierung von Stresssignalen und Konformitätstests von PCIe® 6.0 ASICs.
Fehlerbehebung und Automatisierung von Compliance-Tests für PCIe® 6.0 CEM-Erweiterungskarten und -Systeme.
PCIe® 5.0 Basisempfängertest
Automatisierte Kalibrierung von Stresssignalen und Konformitätstests von PCIe® 5.0 ASICs.
Fehlerbehebung und Automatisierung von Compliance-Tests für PCIe® 5.0 CEM-Erweiterungskarten und -Systeme.
Fehlerbehebung und Automatisierung von Compliance-Tests für PCIe® 5.0 M.2-Geräte und Hosts.
PCIe® 4.0 Basisempfängertest
Automatisierte Kalibrierung von Stresssignalen und Konformitätstests von PCIe® 4.0 ASICs.
Fehlerbehebung und Automatisierung von Compliance-Tests für PCIe® 4.0 CEM-Erweiterungskarten und -Systeme.
Signalintegritätsmessung
Vektornetzwerkanalyse bis zu 4 Ports
Führen Sie schnelle Echtzeitanalysen bis zu 53 GHz durch.
Erweiterte Zeitbereichsanalyse mit TDR
Ausführen Vollständige Gerätecharakterisierung passiver Bauelemente.
Multiport-Vektornetzwerkanalyse
Beschleunigen Sie die Designvalidierung und das Debugging von PCIe- und CXL-Lösungen durch tiefgreifende Protokollkenntnisse, schnellere Ursachenanalyse und mehr Sicherheit in jeder Entwicklungsphase.
PCIe®- und CXL-Protokollanalysatoren
Beschleunigen Sie die Fehlersuche in Ihren Designs dank tiefgreifender Protokolleinblicke und beispielloser Signalintegrität.
Automatisierte PCIe®- und CXL-Datenverkehrsanalyse und Konformitätsprüfung.
PCIe®- und CXL-Protokoll-Trainer
Erzeugt realistischen Datenverkehr bis zu 64 GT/s und emuliert ihn als Hostsystem.
Automatisierte PCIe®- und CXL-Datenverkehrsanalyse und Konformitätsprüfung.
PCIe®- und CXL-Protokoll-Test-Backplanes
Testen Sie mit einer stabilen, kabellosen Rückwandplatine für eine unübertroffene Signalintegrität.
PCIe®- und CXL-Anwendungsfälle
Erfahren Sie mehr über PCIe®- und CXL-Lösungen
Häufig gestellte Fragen zu PCIe®- und CXL-Lösungen
Mit PCIe 6.0 wurde die PAM4-Signalisierung und die FLIT-basierte (Flow Control Unit) Codierung eingeführt, wodurch neue Herausforderungen für die Senderanalyse, die Empfängerkalibrierung, die Entzerrung und das Protokoll-Debugging entstanden.
PCIe 7.0 verdoppelt den Durchsatz erneut auf 128 GT/s und unterstützt damit KI-Beschleuniger der nächsten Generation, Rechenzentrumsinfrastrukturen und Hochleistungsrechnersysteme. Die Validierung trägt dazu bei, Interoperabilität und Systemzuverlässigkeit bei diesen extremen Geschwindigkeiten sicherzustellen.
Durch die Nutzung eines kompletten Testworkflows, der Simulation, Charakterisierung, Protokollanalyse, Konformitätsprüfung und Empfängervalidierung aus einer einzigen Anbieterumgebung umfasst.
CXL ist eine offene Verbindungstechnologie, die auf der PCIe-Physikschicht aufbaut und eine kohärente Kommunikation zwischen CPUs, Beschleunigern, Speichergeräten, GPUs und anderen Systemkomponenten ermöglicht.
CXL verwendet denselben physischen Anschluss und dieselbe elektrische Schnittstelle wie PCIe. Während der Verbindungsinitialisierung können die Geräte aushandeln, ob sie im PCIe-Modus oder im CXL-Modus arbeiten möchten.
Obwohl CXL die physikalische Schicht von PCIe mitnutzt, führt es neue Protokolle, Kohärenzmechanismen, Speichersemantiken und Fabric-Architekturen ein, die spezielle Validierungs- und Debugging-Funktionen erfordern.
Zu den zentralen Herausforderungen gehören:
- Validierung der Gedächtniskohärenz
- Prüfung des Gewebemanagements
- Überprüfung der Speicherpoolung
- Interoperabilität zwischen Anbietern
- Protokollkonformität in komplexen Systemarchitekturen
Memory Pooling ermöglicht es mehreren Hosts oder Beschleunigern, Speicherressourcen dynamisch gemeinsam zu nutzen und so die Auslastung und Skalierbarkeit in KI- und Cloud-Rechenzentrumsumgebungen zu verbessern.
CXL ermöglicht Speichererweiterung, Speicherteilung und disaggregierte Architekturen, die dazu beitragen, den wachsenden Speicher- und Bandbreitenbedarf für KI-Trainings- und Inferenz-Workloads zu decken.
Suchen:
- Unterstützung für aktuelle CXL-Spezifikationen
- Analyse- und Testfähigkeit
- Verkehrserzeugung und Fehlereinspeisung
- Kohärenzvalidierung
- Integration der Speicherprotokollanalyse in PCIe-Protokoll-Debugging-Workflows
Ja. Keysight bietet integrierte Protokollanalysatoren, Übungsgeräte, Software und Lösungen für den Test der physikalischen Schicht, die Ingenieuren helfen, PCIe- und CXL-Designs während des gesamten Entwicklungszyklus zu validieren.
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