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Genesys PLL シンセシスモジュールを使用することで、RFデザイナは、さまざまなRFボード・アプリケーション向けに、アナログPLLをすばやく解析し、ループ・フィルタをシンセシスできます。このような作業に適していない汎用のシミュレータやライブラリを組み合わせて使用する必要はありません。

Genesys PLL シンセシスは、汎用の回路／システム・デザイン・フローをアナログPLLデザイン用に補強する役割をします。これは独自のシミュレータとアルゴリズムを備えた自己完結型のアプリケーションであり、ループ性能の解析と、PLLの実現に必要なループ・フィルタのシンセシスに最適化されています。SPICE、ハーモニック・バランス、リニア・シミュレータ、スプレッドシートなどの汎用ツールとは異なり、PLL シンセシスは高速で、アナログPLLデザインの作業に最適化されています。

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PLL シンセシスで考慮されるもの：

  • 基準信号源特性（位相雑音ブレークポイント、負荷時のQ値、インピーダンス、パワー・レベル）
  • 4種類の位相ディテクタ、およびその特性（位相／周波数ディテクタ、チャージ・ポンプ、ミキサ、XOR）
  • さまざまな積分回路と追加のループ・フィルタ、その特性
  • VCO特性（ユーザ定義チューニング・テーブルおよび位相雑音を含む）
  • ブロック図で使用されるオペアンプの非理想性とノイズ

PLL シンセシスで実行できる解析機能：

  • 周波数応答
  • 過渡応答（セトリングと安定性の観察）
  • 位相雑音性能
  • 応答プロット（マーカと長いトレースのスクロール表示を含む）
  • PLLブロック図のグラフィカル表示（詳細なテキスト・サマリ付き）

PLL シンセシスで実行できるシンセシス機能：

  • さまざまなトポロジーとループ次数のループ・フィルタ・シンセシス
  • 以下のデザイン・プロセスをガイドする5種類のセットアップ・ウィザード
    －周波数シンセサイザ
    －位相変調器
    －周波数変調器
    －位相復調器
    －周波数復調器

この強力なシンセシス機能は、次のGenesysバンドルで使用できます。

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