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Mémoire DDR et LPDDR
L'IA de la prochaine génération présente plusieurs défis pour la technologie de la mémoire. L'entraînement des modèles d'IA nécessite une mémoire à très large bande passante ; une faible latence de la mémoire est nécessaire pour les applications d'inférence. Une capacité de mémoire importante et évolutive est indispensable pour faire face à l'augmentation de la taille des modèles.
Keysight vous propose des solutions de haute précision et ultra-rapides pour chaque étape de votre prochaine conception de double débit de données 5 (DDR5) et de double débit de données 6 à faible consommation (LPDDR6) - pour les centres de données, l'électronique grand public, l'automobile et d'autres systèmes de mémoire.
Solutions DDR de conception à l'essai
L'accélération de la vitesse des réseaux nécessite une mémoire plus rapide. Chaque nouvelle version des normes DDR permet un accès plus rapide aux données stockées dans la mémoire. Lorsque les vitesses de données atteignent 6,4 GT/s avec la DDR5, vous êtes confrontés à de nouveaux défis en matière de conception et de validation. La conception et la simulation des systèmes de mémoire DDR5 vous aident à découvrir les problèmes avant la sortie du silicium et à garantir l'intégrité du signal de vos conceptions. Les logiciels de conception et de simulation vous permettent d'optimiser vos conceptions d'émetteurs, de récepteurs et de canaux pour obtenir les meilleures performances et la meilleure fiabilité à la vitesse souhaitée. Nous pouvons vous aider à concevoir en amont pour résoudre les problèmes d'intégrité du signal, garantir l'efficacité énergétique et rester dans des marges d'erreur étroites avant le prototypage.
Pour garantir l'interopérabilité de votre émetteur DDR5 avec d'autres dispositifs, vous devez le tester par rapport aux normes de conformité JEDEC. Lorsque vous testez vos dispositifs DDR5, automatisez l'étalonnage, la configuration, l'exécution et la documentation de vos tests de conformité à l'aide d'un matériel et d'un logiciel spécialement conçus à cet effet. Idéalement, utilisez un oscilloscope à large bande passante (25 GHz+) avec un nombre effectif de bits élevé, des sondes à large bande passante conçues pour minimiser les effets sur le signal mesuré et des cartes d'interposition pour sonder aussi près que possible du silicium. Associez à cela un logiciel pour la configuration, l'exécution, l'évaluation, l'automatisation et la génération de rapports des tests.
Pour garantir la conformité avec la cinquième génération de dispositifs de mémoire à double débit (DDR5), il faut effectuer une liste exhaustive de tests d'interopérabilité définis par les spécifications du JEDEC. Les tests de conformité des récepteurs de la couche physique impliquent la caractérisation du récepteur, l'étalonnage d'un signal de contrainte à l'aide d'un oscilloscope à grande largeur de bande et des tests de récepteur de dispositif avec un testeur de rapport d'erreur de bits.
La corruption des données est un symptôme courant rencontré lors de la validation des conceptions DDR5. La cause première de la corruption de données peut être difficile à déterminer. En général, vos conceptions présentent des problèmes d'intégrité du signal ou des problèmes fonctionnels.
Lorsque les systèmes de mémoire DDR5 ne se comportent pas comme prévu, vous avez besoin de solutions de débogage fonctionnel, d'analyse et de validation de la conformité au protocole qui offrent des capacités de capture et d'analyse des traces. Nous pouvons vous offrir les informations nécessaires pour comprendre le comportement de votre système et trouver rapidement la cause première de tout problème.
Solutions de conception à l'essai pour LPDDR
Compte tenu des faibles exigences en matière de consommation d'énergie des appareils mobiles, les conceptions LPDDR doivent offrir un meilleur rendement énergétique. La simulation vous permet de détecter les problèmes dans vos conceptions LPDDR à basse tension avant même de passer au prototypage. Concevez vos circuits à l'aide du logiciel PathWave de Keysight et obtenez des informations précieuses sur la gestion de la tension et l'intégrité du signal, garantissant ainsi une synchronisation précise et une diaphonie minimale à des vitesses élevées. Les modèles Advanced prennent en compte la complexité des configurations LPDDR afin d'assurer des performances robustes et la fiabilité de votre conception.
La technologie LPDDR6 permet d'augmenter la bande passante pour le transfert de données tout en réduisant la consommation d'énergie. Un oscilloscope doté d'une bande passante suffisante et d'une intégrité de signal optimale est indispensable pour tester les émetteurs. Pour garantir la conformité à la norme JEDEC et minimiser la durée des tests, Keysight propose les applications d'automatisation des tests les plus complètes, qui fonctionnent main dans la main avec les instruments de test les plus rapides de Keysight.
Le test des récepteurs LPDDR6 pose des défis importants en raison des taux de transfert de données élevés, qui réduisent les marges et rendent le travail de conception et les tests plus complexes. Les outils de test automatisés tels que les testeurs de taux d'erreur sur les bits (BERT), les oscilloscopes et les logiciels de conformité sont essentiels pour relever ces défis au niveau de la couche physique, en garantissant une durée de test minimale, des mesures précises et la conformité aux spécifications JEDEC.
Les tests d'interopérabilité sont également obligatoires au niveau du protocole alors que les vitesses des données LPDDR augmentent. Pour garantir l'intégrité des données, vous devez vous concentrer sur la synchronisation et la surveillance des événements afin de capturer et d'analyser les signaux avec précision. En outre, l'évaluation de l'amélioration des performances grâce à la formation et à la gestion des rafraîchissements garantit un fonctionnement fiable et efficace du système. Keysight propose des solutions adaptées à l'analyse rapide et fiable du protocole LPDDR pour votre conception.
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