Wie man PCIe-Serverplatinenverbindungen testet

Boundary Scan Analyzer
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Bestanden/Nicht bestanden-Boardtest für PCIe-Verbindungen

Die Validierung von PCIe-Server-Motherboards erfordert die Prüfung von Hochgeschwindigkeitsverbindungen, Stromschienen und der Integrität der Steckverbinder in komplexen Leiterplattenbaugruppen. Dabei werden JTAG-Boundary-Scan-Verfahren (Joint Test Action Group) mit Smart Peripheral Component Interconnect Express Plugin-Karten (SPCI-Plug) eingesetzt, um die Konnektivität zwischen CPUs, Speicherschnittstellen und PCIe-Anschlüssen zu überprüfen, ohne während des Testprozesses funktionsfähige Geräte zu installieren.

Der Testaufbau importiert Leiterplattendesigndaten und Boundary-Scan-Bibliotheken in die Validierungssoftware, um Rückkopplungsketten zwischen Prozessor und Smart-Plugin-Karten zu erstellen. Automatisierte Verbindungstests bewerten offene und Kurzschlüsse, das Signalintegritätsverhalten und Erdschlüsse, während die Testautomatisierung das Einstecken der Steckverbinder, die Leistungssequenzierung und die Testausführung für die Serienfertigung steuert.

PCIe-Server-Board-Verbindungstestlösung

Die Validierung von PCIe-Verbindungen erfordert einen Boundary-Scan-Zugriff auf Hochgeschwindigkeits-Lanes, Stromschienen und Motherboard-Anschlüsse, um die Integrität der Signalwege ohne aktive Peripheriegeräte zu überprüfen. Die Lösung kombiniert den x1149 Boundary Scan Analyzer mit Smart PCIe Plugin-Karten und automatisierter Testvorrichtungssteuerung, um die Validierung von Verbindungen, Loopback-Tests und die Analyse von Stromschienen über verschiedene Server-Motherboard-Architekturen hinweg durchzuführen. Die Smart Plugin-Karten bieten Boundary-Scan-Funktionalität, die die Validierung von PCIe-Signal-, Strom- und Masseverbindungen ermöglicht und gleichzeitig das Risiko von Beschädigungen durch wiederholtes Einstecken aktiver Komponenten reduziert. Die Lösung unterstützt außerdem die GPU-gesteuerte Testvorrichtungsautomatisierung, die Konfiguration von Loopback-Ketten, die automatisierte Testgenerierung und die automatische Software-Optimierung, um die Wiederholgenauigkeit zu verbessern und die Entwicklung von Fertigungstests für Serverplattformen mit hoher Packungsdichte zu optimieren.

Siehe Blockdiagramm der PCIe-Server-Board-Verbindungstestlösung

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