Comment tester les interconnexions PCIe d'une carte mère de serveur

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Test de conformité « Réussite/Échec » pour les interconnexions PCIe

La validation des cartes mères de serveurs PCIe nécessite de tester les interconnexions à haut débit, les rails d'alimentation et l'intégrité des connecteurs sur des assemblages complexes de cartes de circuits imprimés. Ce processus utilise les techniques de scan de périphérie du Joint Test Action Group (JTAG) avec des cartes Smart Peripheral Component Interconnect Express Plugin afin de vérifier la connectivité entre les processeurs, les interfaces mémoire et les connecteurs PCIe sans avoir à installer de périphériques fonctionnels sous tension pendant la phase de test.

Le banc d'essai importe les données de conception de la carte et les bibliothèques « boundary-scan » dans le logiciel de validation afin de créer des chaînes de bouclage entre le processeur et les cartes Smart Plugin. Des tests d'interconnexion automatisés évaluent les conditions de circuit ouvert et de court-circuit, le comportement en matière d'intégrité du signal et les défauts d'alimentation vers la masse, tandis que l'automatisation du dispositif de fixation contrôle l'insertion des connecteurs, la séquence d'alimentation et l'exécution des tests pour les environnements de fabrication à grand volume.

Solution de test d'interconnexion pour cartes mères de serveurs PCIe

La validation des interconnexions PCIe nécessite un accès « boundary-scan » aux voies haut débit, aux rails d’alimentation et aux connecteurs de la carte mère afin de vérifier l’intégrité du cheminement des signaux sans recourir à des périphériques actifs. La solution combine l’analyseur « boundary-scan » x1149 avec des cartes « Smart PCIe Plugin » et un contrôle automatisé des fixations pour effectuer la validation des interconnexions, les tests de bouclage et l’analyse des rails d’alimentation sur différentes architectures de cartes mères de serveurs. Les cartes Smart Plugin offrent une fonctionnalité « boundary-scan » qui permet de valider les connexions de signaux, d’alimentation et de masse PCIe tout en réduisant le risque de dommages liés à l’insertion répétée de composants sous tension. La solution prend également en charge l’automatisation des fixations contrôlées par General Purpose Input Output (GPIO), la configuration de chaînes de bouclage, la génération automatisée de tests et l’optimisation par auto-ajustement logiciel afin d’améliorer la répétabilité et de rationaliser le développement des tests de fabrication pour les plateformes de serveurs à haute densité.
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