Come accelerare la verifica Ethernet pre-silicio
Individuare i problemi di progettazione prima del tape-out
La verifica degli ASIC e dei SoC Ethernet in fase pre-silicio diventa complessa quando gli ingegneri devono testare la logica di inoltro, il comportamento dei buffer e la gestione dei protocolli prima che l’hardware fisico sia disponibile. I team di test devono riprodurre condizioni di traffico realistiche a livello 2 e 3, variare le caratteristiche dei pacchetti e la portata del traffico, e determinare se il progetto si comporta correttamente in scenari normali, sotto carico e in casi limite.
Il flusso di lavoro di verifica richiede un ambiente di traffico virtuale collegato alla piattaforma di emulazione hardware, in modo che gli ingegneri possano generare traffico Ethernet controllato prima del tape-out. Gli ingegneri confrontano il comportamento di inoltro previsto con quello osservato, monitorano la velocità di trasmissione e la latenza e analizzano i malfunzionamenti che emergono solo in condizioni di traffico su larga scala o con modelli complessi. Ciò consente di isolare i difetti di progettazione mentre il progetto del silicio è ancora modificabile.
Soluzione accelerata per la verifica Ethernet pre-silicio
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