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Analisi del canale laterale pre-silicio Inspector SC2

Rileva, individua e mitiga le fughe di informazioni tramite canali laterali prima del tape-out. L'analisi dei canali laterali pre-silicio Inspector SC2 consente ai team addetti alla sicurezza hardware, alla progettazione e alla verifica di identificare le vulnerabilità dei canali laterali durante la fase di progettazione e sviluppo, prima della produzione del silicio (pre-silicio). Mentre i tradizionali test post-silicio possono determinare se esistono fughe di informazioni in un dispositivo fabbricato, l’analisi dei canali laterali pre-silicio di Inspector SC2 offre visibilità sull’origine delle fughe all’interno del progetto, aiutando i team a identificare la causa principale e a valutare le strategie di mitigazione nelle prime fasi del ciclo di vita dello sviluppo. Analizzando i progetti a livello di trasferimento dei registri (RTL), la netlist sintetizzata e i progetti a livello di gate utilizzando vettori di test e dati sulle attività di progettazione, l’analisi dei canali laterali pre-silicio di Inspector SC2 identifica quali segnali presentano perdite, l’entità di tali perdite, quando si verificano e da dove hanno origine all’interno del progetto. Questa visibilità consente ai team di convalidare le contromisure, confrontare alternative di progettazione e ridurre i costi e i rischi legati all’individuazione di vulnerabilità dopo la produzione.

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Punti salienti

L'analisi dei canali laterali pre-silicio di Inspector SC2 aiuta i team che operano nel settore dei semiconduttori a individuare e localizzare le perdite tramite canali laterali prima del tape-out, quando le modifiche al progetto sono più rapide, meno costose e più facili da implementare.

Utilizzando vettori di test, file di attività VCD e modelli di potenza opzionali generati tramite flussi di lavoro EDA (Electronic Design Automation) esistenti, Inspector analizza i progetti RTL, le netlist sintetizzate e i progetti a livello di gate per identificare le perdite, misurarne la gravità e individuare con precisione i segnali e i moduli responsabili. Grazie a un’analisi delle cause alla radice che si traduce in azioni concrete, i team possono convalidare le contromisure, confrontare le opzioni di implementazione e confrontare le perdite tra i progetti RTL, le netlist sintetizzate e i progetti a livello di gate per identificare le modifiche introdotte durante il flusso di progettazione.

  • Individuare eventuali perdite tramite canali laterali prima del tape-out (fase pre-silicio), quando le modifiche al progetto sono ancora fattibili ed economicamente vantaggiose.
  • Integrare i test tradizionali post-silicio individuando le vulnerabilità in una fase più precoce del ciclo di sviluppo.
  • Individua automaticamente la causa principale delle perdite, individuando segnali, porte e moduli specifici.
  • Individuare quali segnali presentano perdite, in che misura e quando si verificano, utilizzando metriche quantitative relative alle perdite.
  • Verificare l'efficacia delle contromisure contro gli attacchi tramite canale laterale e confrontare le diverse implementazioni.
  • Analizzare i progetti RTL, le netlist sintetizzate e i progetti a livello di gate durante l'intero flusso di sviluppo.
  • Individuare le perdite che si verificano durante la sintesi e l'ottimizzazione man mano che i progetti si evolvono.
  • Supportare la verifica continua della sicurezza e i test di regressione.
  • Consentire ai team di progettazione e verifica, e non solo agli specialisti della sicurezza, di individuare e risolvere i problemi di sicurezza.
  • Generare report e visualizzazioni personalizzabili utilizzando script Python per flussi di lavoro interni, revisioni e attività di certificazione.
  • Ridurre l'impegno richiesto dai test post-silicio, i rischi legati alla certificazione e le costose riprogettazioni successive alla produzione.
  • Valutare i compromessi in materia di sicurezza, tenendo conto anche delle considerazioni relative a prestazioni, consumo energetico e area.

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