Comment caractériser et tester la conformité des récepteurs DDR5

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Mise en place d'un test de conformité du récepteur DDR5

Pour garantir la conformité de la cinquième génération de dispositifs de mémoire à double débit (DDR5), il faut exécuter une liste exhaustive de tests d'interopérabilité définis dans les spécifications du JEDEC. Les tests de conformité des récepteurs de la couche physique impliquent la caractérisation du récepteur, l'étalonnage d'un signal de contrainte à l'aide d'un oscilloscope à grande largeur de bande et des tests de récepteurs de dispositifs à l'aide d'un testeur de taux d'erreur sur les bits.

L'étalonnage du dispositif de test nécessite des instruments précis et est sujet à des erreurs de la part de l'utilisateur, surtout s'il ne maîtrise pas les nuances des dernières spécifications de test de conformité DDR5. Effectuer manuellement chaque mesure du taux d'erreur binaire sur la DRAM DDR5 ou un autre dispositif avec le signal de stress calibré, enregistrer les résultats et les comparer avec les spécifications du test prend beaucoup de temps. Un logiciel automatisé de test de conformité des récepteurs DDR5 est nécessaire.

Solution de test de conformité des récepteurs DDR5

Les tests de récepteurs DDR5 selon les spécifications JEDEC nécessitent des outils de test précis. La solution de test de conformité des récepteurs DDR5 de Keysight comprend le logiciel d’automatisation des tests de récepteurs M80885RCA, fonctionnant sur le testeur de taux d’erreurs binaires M8040A, qui facilite la configuration, l’exécution des tests, l’évaluation des résultats et la documentation de conformité afin de garantir le respect des spécifications DDR5. L'oscilloscope Keysight de la série UXR, associé au logiciel d'intégrité du signal D9120ASIA et au logiciel d'analyse de gigue D9120JITA, est utilisé pour caractériser le récepteur.
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